什么是信號完整性？
信號完整性主要目的是在連結的線路中，維持信號完整的傳遞且不受其他因素干擾。而信號的檢測結果，可能會因以下各種變因，皆可能影響量測信號好壞。
1. 測試點位
2. 受測物焊接角度
3. 信號走線長短
4. 周遭組件干擾
5. 橋接信號板
6. 量測手法
測試點位位置不同，測試結果的差異
信號完整性測試的重要性
隨著工程技術的演進，新產品的開發結合各種外在的變因，信號完整度測試難度，比起過往單純設備與環境已大幅提升。透過啟威測的專業人員以及精密儀器，可從關鍵性問題找出產品潛藏的風險，避免造成產品上市后的再次除錯與耗損。
啟威測信號量測能力介紹Signal Measurement Capability：
總線信號/ BUS Signal
(DDR2/3/4, Nand/Nor Flash, GDDR3/5, eMMC, Clock etc.)
媒體信號/ Media Signal
(D-Sub, DVI, LVDS, HDMI1.4/2.0, DisplayPort1.2/1.4,MIPI etc.)
高速串行信號/ High-speed Serial Signal
(Ethernet, USB2.0/3.0/3.1, SATA2/3, SAS2/3 PCIe 2.0/3.0 etc.)
電源/ Power
(Power Noise, Reset, Power Sequence etc.)
低速信號/ Low-speed Signal
(I2C/I2S, SDIO, Uart_BT, LPC, AC link, SPI etc.)
數字存儲示波器參數介紹：
Bandwidth (帶寬) : 8GHz
Sample Rate (采樣率) : 20GS/s
Record Depth (存儲深度) : 2MByte
Rise Time (上升時間20%~80%）: 35ps
Input Sensitivity (輸入靈敏度) : 5 mV/div to 1 V/div
Noise (底噪) typical: 950 μV/100mV/div
Timebase Range(時基范圍): 25 ps to 40 s/div;
Trigger Jitter(觸發抖動)(RMS):<1.5 psRMS (typical)
Jitter Noise Floor(抖動噪低): 420 fsRMS (typical)
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